Refactor the control_check_pc API. #1234

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Timmmm merged 1 commit into riscv:master from pmundkur:refactor_control_check_pc

Sep 7, 2025

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Refactor the control_check_pc API. #1234

Refactor the control_check_pc API.

GitHub Actions / Test Results succeeded Sep 2, 2025 in 0s

All 2 101 tests pass in 15m 48s

2 101 tests ±0 2 101 ✅ ±0 15m 48s ⏱️ +5s
1 suites ±0 0 💤 ±0
1 files ±0 0 ❌ ±0

Results for commit 529f45c. ± Comparison against earlier commit 3a308fb.

Annotations

Check notice on line 0 in .github

github-actions / Test Results

2101 tests found (test 1 to 746)

There are 2101 tests, see "Raw output" for the list of tests 1 to 746.

Raw output


            2025-07-16/riscv-tests/rv32mi-p-breakpoint ‑ 2025-07-16/riscv-tests/rv32mi-p-breakpoint
2025-07-16/riscv-tests/rv32mi-p-csr ‑ 2025-07-16/riscv-tests/rv32mi-p-csr
2025-07-16/riscv-tests/rv32mi-p-illegal ‑ 2025-07-16/riscv-tests/rv32mi-p-illegal
2025-07-16/riscv-tests/rv32mi-p-instret_overflow ‑ 2025-07-16/riscv-tests/rv32mi-p-instret_overflow
2025-07-16/riscv-tests/rv32mi-p-lh-misaligned ‑ 2025-07-16/riscv-tests/rv32mi-p-lh-misaligned
2025-07-16/riscv-tests/rv32mi-p-lw-misaligned ‑ 2025-07-16/riscv-tests/rv32mi-p-lw-misaligned
2025-07-16/riscv-tests/rv32mi-p-ma_addr ‑ 2025-07-16/riscv-tests/rv32mi-p-ma_addr
2025-07-16/riscv-tests/rv32mi-p-ma_fetch ‑ 2025-07-16/riscv-tests/rv32mi-p-ma_fetch
2025-07-16/riscv-tests/rv32mi-p-mcsr ‑ 2025-07-16/riscv-tests/rv32mi-p-mcsr
2025-07-16/riscv-tests/rv32mi-p-pmpaddr ‑ 2025-07-16/riscv-tests/rv32mi-p-pmpaddr
2025-07-16/riscv-tests/rv32mi-p-sbreak ‑ 2025-07-16/riscv-tests/rv32mi-p-sbreak
2025-07-16/riscv-tests/rv32mi-p-scall ‑ 2025-07-16/riscv-tests/rv32mi-p-scall
2025-07-16/riscv-tests/rv32mi-p-sh-misaligned ‑ 2025-07-16/riscv-tests/rv32mi-p-sh-misaligned
2025-07-16/riscv-tests/rv32mi-p-shamt ‑ 2025-07-16/riscv-tests/rv32mi-p-shamt
2025-07-16/riscv-tests/rv32mi-p-sw-misaligned ‑ 2025-07-16/riscv-tests/rv32mi-p-sw-misaligned
2025-07-16/riscv-tests/rv32mi-p-zicntr ‑ 2025-07-16/riscv-tests/rv32mi-p-zicntr
2025-07-16/riscv-tests/rv32si-p-csr ‑ 2025-07-16/riscv-tests/rv32si-p-csr
2025-07-16/riscv-tests/rv32si-p-dirty ‑ 2025-07-16/riscv-tests/rv32si-p-dirty
2025-07-16/riscv-tests/rv32si-p-ma_fetch ‑ 2025-07-16/riscv-tests/rv32si-p-ma_fetch
2025-07-16/riscv-tests/rv32si-p-sbreak ‑ 2025-07-16/riscv-tests/rv32si-p-sbreak
2025-07-16/riscv-tests/rv32si-p-scall ‑ 2025-07-16/riscv-tests/rv32si-p-scall
2025-07-16/riscv-tests/rv32si-p-wfi ‑ 2025-07-16/riscv-tests/rv32si-p-wfi
2025-07-16/riscv-tests/rv32ua-p-amoadd_w ‑ 2025-07-16/riscv-tests/rv32ua-p-amoadd_w
2025-07-16/riscv-tests/rv32ua-p-amoand_w ‑ 2025-07-16/riscv-tests/rv32ua-p-amoand_w
2025-07-16/riscv-tests/rv32ua-p-amomax_w ‑ 2025-07-16/riscv-tests/rv32ua-p-amomax_w
2025-07-16/riscv-tests/rv32ua-p-amomaxu_w ‑ 2025-07-16/riscv-tests/rv32ua-p-amomaxu_w
2025-07-16/riscv-tests/rv32ua-p-amomin_w ‑ 2025-07-16/riscv-tests/rv32ua-p-amomin_w
2025-07-16/riscv-tests/rv32ua-p-amominu_w ‑ 2025-07-16/riscv-tests/rv32ua-p-amominu_w
2025-07-16/riscv-tests/rv32ua-p-amoor_w ‑ 2025-07-16/riscv-tests/rv32ua-p-amoor_w
2025-07-16/riscv-tests/rv32ua-p-amoswap_w ‑ 2025-07-16/riscv-tests/rv32ua-p-amoswap_w
2025-07-16/riscv-tests/rv32ua-p-amoxor_w ‑ 2025-07-16/riscv-tests/rv32ua-p-amoxor_w
2025-07-16/riscv-tests/rv32ua-p-lrsc ‑ 2025-07-16/riscv-tests/rv32ua-p-lrsc
2025-07-16/riscv-tests/rv32ua-v-amoadd_w ‑ 2025-07-16/riscv-tests/rv32ua-v-amoadd_w
2025-07-16/riscv-tests/rv32ua-v-amoand_w ‑ 2025-07-16/riscv-tests/rv32ua-v-amoand_w
2025-07-16/riscv-tests/rv32ua-v-amomax_w ‑ 2025-07-16/riscv-tests/rv32ua-v-amomax_w
2025-07-16/riscv-tests/rv32ua-v-amomaxu_w ‑ 2025-07-16/riscv-tests/rv32ua-v-amomaxu_w
2025-07-16/riscv-tests/rv32ua-v-amomin_w ‑ 2025-07-16/riscv-tests/rv32ua-v-amomin_w
2025-07-16/riscv-tests/rv32ua-v-amominu_w ‑ 2025-07-16/riscv-tests/rv32ua-v-amominu_w
2025-07-16/riscv-tests/rv32ua-v-amoor_w ‑ 2025-07-16/riscv-tests/rv32ua-v-amoor_w
2025-07-16/riscv-tests/rv32ua-v-amoswap_w ‑ 2025-07-16/riscv-tests/rv32ua-v-amoswap_w
2025-07-16/riscv-tests/rv32ua-v-amoxor_w ‑ 2025-07-16/riscv-tests/rv32ua-v-amoxor_w
2025-07-16/riscv-tests/rv32ua-v-lrsc ‑ 2025-07-16/riscv-tests/rv32ua-v-lrsc
2025-07-16/riscv-tests/rv32uc-p-rvc ‑ 2025-07-16/riscv-tests/rv32uc-p-rvc
2025-07-16/riscv-tests/rv32uc-v-rvc ‑ 2025-07-16/riscv-tests/rv32uc-v-rvc
2025-07-16/riscv-tests/rv32ud-p-fadd ‑ 2025-07-16/riscv-tests/rv32ud-p-fadd
2025-07-16/riscv-tests/rv32ud-p-fclass ‑ 2025-07-16/riscv-tests/rv32ud-p-fclass
2025-07-16/riscv-tests/rv32ud-p-fcmp ‑ 2025-07-16/riscv-tests/rv32ud-p-fcmp
2025-07-16/riscv-tests/rv32ud-p-fcvt ‑ 2025-07-16/riscv-tests/rv32ud-p-fcvt
2025-07-16/riscv-tests/rv32ud-p-fcvt_w ‑ 2025-07-16/riscv-tests/rv32ud-p-fcvt_w
2025-07-16/riscv-tests/rv32ud-p-fdiv ‑ 2025-07-16/riscv-tests/rv32ud-p-fdiv
2025-07-16/riscv-tests/rv32ud-p-fmadd ‑ 2025-07-16/riscv-tests/rv32ud-p-fmadd
2025-07-16/riscv-tests/rv32ud-p-fmin ‑ 2025-07-16/riscv-tests/rv32ud-p-fmin
2025-07-16/riscv-tests/rv32ud-p-ldst ‑ 2025-07-16/riscv-tests/rv32ud-p-ldst
2025-07-16/riscv-tests/rv32ud-p-recoding ‑ 2025-07-16/riscv-tests/rv32ud-p-recoding
2025-07-16/riscv-tests/rv32ud-v-fadd ‑ 2025-07-16/riscv-tests/rv32ud-v-fadd
2025-07-16/riscv-tests/rv32ud-v-fclass ‑ 2025-07-16/riscv-tests/rv32ud-v-fclass
2025-07-16/riscv-tests/rv32ud-v-fcmp ‑ 2025-07-16/riscv-tests/rv32ud-v-fcmp
2025-07-16/riscv-tests/rv32ud-v-fcvt ‑ 2025-07-16/riscv-tests/rv32ud-v-fcvt
2025-07-16/riscv-tests/rv32ud-v-fcvt_w ‑ 2025-07-16/riscv-tests/rv32ud-v-fcvt_w
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2025-07-16/riscv-tests/rv32ud-v-fmadd ‑ 2025-07-16/riscv-tests/rv32ud-v-fmadd
2025-07-16/riscv-tests/rv32ud-v-fmin ‑ 2025-07-16/riscv-tests/rv32ud-v-fmin
2025-07-16/riscv-tests/rv32ud-v-ldst ‑ 2025-07-16/riscv-tests/rv32ud-v-ldst
2025-07-16/riscv-tests/rv32ud-v-recoding ‑ 2025-07-16/riscv-tests/rv32ud-v-recoding
2025-07-16/riscv-tests/rv32uf-p-fadd ‑ 2025-07-16/riscv-tests/rv32uf-p-fadd
2025-07-16/riscv-tests/rv32uf-p-fclass ‑ 2025-07-16/riscv-tests/rv32uf-p-fclass
2025-07-16/riscv-tests/rv32uf-p-fcmp ‑ 2025-07-16/riscv-tests/rv32uf-p-fcmp
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2025-07-16/riscv-tests/rv32uf-p-fdiv ‑ 2025-07-16/riscv-tests/rv32uf-p-fdiv
2025-07-16/riscv-tests/rv32uf-p-fmadd ‑ 2025-07-16/riscv-tests/rv32uf-p-fmadd
2025-07-16/riscv-tests/rv32uf-p-fmin ‑ 2025-07-16/riscv-tests/rv32uf-p-fmin
2025-07-16/riscv-tests/rv32uf-p-ldst ‑ 2025-07-16/riscv-tests/rv32uf-p-ldst
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2025-07-16/riscv-tests/rv32ui-p-beq ‑ 2025-07-16/riscv-tests/rv32ui-p-beq
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2025-07-16/riscv-tests/rv32ui-p-bgeu ‑ 2025-07-16/riscv-tests/rv32ui-p-bgeu
2025-07-16/riscv-tests/rv32ui-p-blt ‑ 2025-07-16/riscv-tests/rv32ui-p-blt
2025-07-16/riscv-tests/rv32ui-p-bltu ‑ 2025-07-16/riscv-tests/rv32ui-p-bltu
2025-07-16/riscv-tests/rv32ui-p-bne ‑ 2025-07-16/riscv-tests/rv32ui-p-bne
2025-07-16/riscv-tests/rv32ui-p-fence_i ‑ 2025-07-16/riscv-tests/rv32ui-p-fence_i
2025-07-16/riscv-tests/rv32ui-p-jal ‑ 2025-07-16/riscv-tests/rv32ui-p-jal
2025-07-16/riscv-tests/rv32ui-p-jalr ‑ 2025-07-16/riscv-tests/rv32ui-p-jalr
2025-07-16/riscv-tests/rv32ui-p-lb ‑ 2025-07-16/riscv-tests/rv32ui-p-lb
2025-07-16/riscv-tests/rv32ui-p-lbu ‑ 2025-07-16/riscv-tests/rv32ui-p-lbu
2025-07-16/riscv-tests/rv32ui-p-ld_st ‑ 2025-07-16/riscv-tests/rv32ui-p-ld_st
2025-07-16/riscv-tests/rv32ui-p-lh ‑ 2025-07-16/riscv-tests/rv32ui-p-lh
2025-07-16/riscv-tests/rv32ui-p-lhu ‑ 2025-07-16/riscv-tests/rv32ui-p-lhu
2025-07-16/riscv-tests/rv32ui-p-lui ‑ 2025-07-16/riscv-tests/rv32ui-p-lui
2025-07-16/riscv-tests/rv32ui-p-lw ‑ 2025-07-16/riscv-tests/rv32ui-p-lw
2025-07-16/riscv-tests/rv32ui-p-ma_data ‑ 2025-07-16/riscv-tests/rv32ui-p-ma_data
2025-07-16/riscv-tests/rv32ui-p-or ‑ 2025-07-16/riscv-tests/rv32ui-p-or
2025-07-16/riscv-tests/rv32ui-p-ori ‑ 2025-07-16/riscv-tests/rv32ui-p-ori
2025-07-16/riscv-tests/rv32ui-p-sb ‑ 2025-07-16/riscv-tests/rv32ui-p-sb
2025-07-16/riscv-tests/rv32ui-p-sh ‑ 2025-07-16/riscv-tests/rv32ui-p-sh
2025-07-16/riscv-tests/rv32ui-p-simple ‑ 2025-07-16/riscv-tests/rv32ui-p-simple
2025-07-16/riscv-tests/rv32ui-p-sll ‑ 2025-07-16/riscv-tests/rv32ui-p-sll
2025-07-16/riscv-tests/rv32ui-p-slli ‑ 2025-07-16/riscv-tests/rv32ui-p-slli
2025-07-16/riscv-tests/rv32ui-p-slt ‑ 2025-07-16/riscv-tests/rv32ui-p-slt
2025-07-16/riscv-tests/rv32ui-p-slti ‑ 2025-07-16/riscv-tests/rv32ui-p-slti
2025-07-16/riscv-tests/rv32ui-p-sltiu ‑ 2025-07-16/riscv-tests/rv32ui-p-sltiu
2025-07-16/riscv-tests/rv32ui-p-sltu ‑ 2025-07-16/riscv-tests/rv32ui-p-sltu
2025-07-16/riscv-tests/rv32ui-p-sra ‑ 2025-07-16/riscv-tests/rv32ui-p-sra
2025-07-16/riscv-tests/rv32ui-p-srai ‑ 2025-07-16/riscv-tests/rv32ui-p-srai
2025-07-16/riscv-tests/rv32ui-p-srl ‑ 2025-07-16/riscv-tests/rv32ui-p-srl
2025-07-16/riscv-tests/rv32ui-p-srli ‑ 2025-07-16/riscv-tests/rv32ui-p-srli
2025-07-16/riscv-tests/rv32ui-p-st_ld ‑ 2025-07-16/riscv-tests/rv32ui-p-st_ld
2025-07-16/riscv-tests/rv32ui-p-sub ‑ 2025-07-16/riscv-tests/rv32ui-p-sub
2025-07-16/riscv-tests/rv32ui-p-sw ‑ 2025-07-16/riscv-tests/rv32ui-p-sw
2025-07-16/riscv-tests/rv32ui-p-xor ‑ 2025-07-16/riscv-tests/rv32ui-p-xor
2025-07-16/riscv-tests/rv32ui-p-xori ‑ 2025-07-16/riscv-tests/rv32ui-p-xori
2025-07-16/riscv-tests/rv32ui-v-add ‑ 2025-07-16/riscv-tests/rv32ui-v-add
2025-07-16/riscv-tests/rv32ui-v-addi ‑ 2025-07-16/riscv-tests/rv32ui-v-addi
2025-07-16/riscv-tests/rv32ui-v-and ‑ 2025-07-16/riscv-tests/rv32ui-v-and
2025-07-16/riscv-tests/rv32ui-v-andi ‑ 2025-07-16/riscv-tests/rv32ui-v-andi
2025-07-16/riscv-tests/rv32ui-v-auipc ‑ 2025-07-16/riscv-tests/rv32ui-v-auipc
2025-07-16/riscv-tests/rv32ui-v-beq ‑ 2025-07-16/riscv-tests/rv32ui-v-beq
2025-07-16/riscv-tests/rv32ui-v-bge ‑ 2025-07-16/riscv-tests/rv32ui-v-bge
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github-actions / Test Results

2101 tests found (test 747 to 1308)

There are 2101 tests, see "Raw output" for the list of tests 747 to 1308.

Raw output


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2101 tests found (test 1309 to 1881)

There are 2101 tests, see "Raw output" for the list of tests 1309 to 1881.

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2101 tests found (test 1882 to 2101)

There are 2101 tests, see "Raw output" for the list of tests 1882 to 2101.

Raw output


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